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[单选题]

加法器采用先行进位的目的是()。

A.提高加法器的速度与快速传递进位信号

B.提高加法器的精度

C.优化加法器结构

D.增强加法器功能

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第1题

加法器采用并行进位的目的是()

A.提高加法器的速度

B.快速传递进位信号

C.优化加法器结构

D.增强加法器功能

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第2题

与4位串行进位加法器比较,使用超前进位全加器的目的是()

A.完成自动加法进位

B.完成4位加法

C.提高运算速度

D.完成4位串行加法

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第3题

超前进位加法器比串行进位加法器速度慢()
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第4题

由n个1位全加器构成n位加法器时_如果进位值串行传送_则称为进位的加法器。;()

A.全;

B.单;

C.传递;

D.行波;

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第5题

串行加法器是指串行进位的加法器()
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第6题

乘法器的硬件结构通常采用()。

A.串行加法器的串行移位器

B.并行加法器和串行左移

C.并行加法器和串行右移

D.串行加法器和串行右移

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第7题

不考虑低位进位,只有两个加数的加法器,称为

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第8题

下列不属于组合逻辑电路的加法器为o()

A.半加器

B.全加器

C.多位加法器

D.计数器

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第9题

在定点二进制运算器中_减法运算一般通过来实现的。;()

A.原码运算的十进制加法器;

B.原码运算的二进制减法器;

C.补码运算的二进制减法器;

D.补码运算的二进制加法器;

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第10题

以下哪个属于时序逻辑电路()

A.加法器

B.与门

C.寄存器

D.减法器

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